Cohérence des caches pour multiprocesseurs autres qu'à bus commun

Date de publication :

07/06/2009

Langue :

Français

Format :

.pdf

Nombre de pages :

3 pages

Niveau :

grand public

Consulté :

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non évalué

Validé par :

le comité Oboulo.com

Sommaire :

 
 

Sommaire Cohérence des caches pour multiprocesseurs autres qu'à bus commun Sommaire

 
  1. Qualités et limitations du bus commun
  2. Cohérence des caches dans le cas général
  3. Algorithme du vecteur de présence
  4. Un algorithme ''scalable''

Résumé :

Le bus commun est le moyen le plus naturel pour passer d'une architecture mono à une architecture multiprocesseur : on « greffe » sur le bus mémoire d'autres processeurs. La présence de caches conduit au problème de la cohérence des données et la mise en place d'une logique de type espion de bus permet de coordonner l'évolution simultanée des données dans tous les caches. Le bus commun apparaît alors comme une sorte de place publique où chacun dit aux autres ce qu'il veut faire, à tour de rôle. Mais la taille de la place est limitée et dès que le nombre de processeurs dépasse un certain seuil, un temps d'attente de plus en plus important apparaît avant de pouvoir prendre la parole. La fréquence des demandes d'un processeur d'accès au bus commun dépend de sa fréquence d'horloge, des caractéristiques de sa hiérarchie de caches et dans une certaine mesure de la nature des applications traitées.

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A propos de l'auteur :

pencil image Romain B. etudiant
Niveau :Grand public Etude suivie : Informatique Ecole, université : Master Paul Sab

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